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64字節(jié)RAM DSSHA1協(xié)處理器是一個可合成的寄存器傳輸級(RTL)的FIPS 180-3的安全散列算法(SHA - 1)的實施，消除了需要開發(fā)軟件來執(zhí)行復(fù)雜SHA - 1計算需要進(jìn)行身份驗證SHA - 1器件。 該DSSHA1可以計算與Maxim的SHA - 1器件，如DS1963S，DS1961S的，DS28E10，DS28E02，DS2460的，DS28CN01和的DS28E01 - 100，使用SHA - 1消息認(rèn)證碼(MAC)。 該設(shè)備可以輸出從對SHA - 1的從器件所需的寄存器比較20字節(jié)MAC結(jié)果。 當(dāng)把一個設(shè)計中，還提供了一個卸載DSSHA1功能，緩解了執(zhí)行的SHA - 1計算微控制器。
關(guān)鍵特性
SHA - 1的計算在670個時鐘周期(在典型的50MHz的頻率13.4μs)
面積的估計是102256微米臺積電CL018G 2(0.18通用過程)
專用的硬件加速SHA - 1引擎生成互助委員會
64字節(jié)RAM的消息輸入
5個32位寄存器讀取MAC結(jié)果
在綜合的Verilog ?可用
作為一個低級別模塊用來被實例化一個頂級模塊
包括測試臺
