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      電子發(fā)燒友網>電子資料下載>IC datasheet pdf>SN74ALVCH16500,pdf(18-BIT UNIV

      SN74ALVCH16500,pdf(18-BIT UNIV

      2010-08-21 | rar | 349 | 次下載 | 2積分

      資料介紹

      This 18-bit universal bus transceiver is designed for 1.65-V to 3.6-V VCC operation.

      Data flow in each direction is controlled by output-enable (OEAB and OEBA\), latch-enable (LEAB and LEBA), and clock (CLKAB\ and CLKBA\) inputs. For A-to-B data flow, the device operates in the transparent mode when LEAB is high. When LEAB is low, the A data is latched if CLKAB\ is held at a high or low logic level. If LEAB is low, the A data is stored in the latch/flip-flop on the high-to-low transition of CLKAB\. Output-enable OEAB is active high. When OEAB is high, the B-port outputs are active. When OEAB is low, the B-port outputs are in the high-impedance state.

      Data flow for B to A is similar to that of A to B, but uses OEBA\, LEBA, and CLKBA\.

      transceive
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