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在QuartusⅡ軟件平臺(tái)下，運(yùn)用verilog硬件描述語(yǔ)言和DE2來(lái)實(shí)現(xiàn)數(shù)字時(shí)鐘功能。數(shù)字時(shí)鐘包括組合邏輯電路和時(shí)序電路，能夠正確顯示時(shí)、分、秒，并有校時(shí)、暫停功能，要求在數(shù)碼管上正確顯示。
在完成基本要求的基礎(chǔ)上，可進(jìn)一步增加功能、提高性能，如增加鬧鈴功能。
數(shù)字時(shí)鐘是一個(gè)對(duì)標(biāo)準(zhǔn)頻率（1Hz）進(jìn)行計(jì)數(shù)的計(jì)數(shù)電路。數(shù)字時(shí)鐘分為分頻器、時(shí)計(jì)數(shù)器、分計(jì)數(shù)器、秒計(jì)數(shù)器，當(dāng)秒計(jì)數(shù)器計(jì)滿60后觸發(fā)分計(jì)數(shù)器，分計(jì)數(shù)器計(jì)滿60后觸發(fā)時(shí)計(jì)數(shù)器，當(dāng)計(jì)滿24小時(shí)后又開始下一輪循環(huán)。通過(guò)校時(shí)電路可對(duì)分和時(shí)進(jìn)行校正，通過(guò)暫停鍵實(shí)現(xiàn)暫停功能。數(shù)字時(shí)鐘要完成顯示需要6個(gè)數(shù)碼管，數(shù)碼管顯示要用到7段數(shù)碼顯示譯碼器程序來(lái)正確顯示時(shí)間。
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