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pll

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pll技術(shù)

兩款具有優(yōu)秀相位噪聲性能組成的PLL合成器介紹

兩款具有優(yōu)秀相位噪聲性能組成的PLL合成器介紹

在產(chǎn)生高頻,高線(xiàn)性度信號(hào)源時(shí),低相位噪聲至關(guān)重要。相位噪聲是信號(hào)的不期望的變化或相位變化的量度。它在頻域中測(cè)量并且等于時(shí)域中的抖動(dòng)。使用PLL合成器時(shí),...

2019-04-16 標(biāo)簽:振蕩器合成器pll 5k 0

AN143模型可精確預(yù)測(cè)PLL系統(tǒng)中參考雜散電平的產(chǎn)生

AN143模型可精確預(yù)測(cè)PLL系統(tǒng)中參考雜散電平的產(chǎn)生

介紹的是一個(gè)簡(jiǎn)單的模型,可用于精確預(yù)測(cè)由于PLL系統(tǒng)中的電荷泵和/或運(yùn)算放大器泄漏電流引起的參考雜散電平。知道如何預(yù)測(cè)這些電平有助于在PLL系統(tǒng)設(shè)計(jì)的早...

2019-04-16 標(biāo)簽:振蕩器運(yùn)算放大器pll 4.4k 0

淺析芯片中PLL中的相位噪聲

淺析芯片中PLL中的相位噪聲

時(shí)鐘抖動(dòng)是指實(shí)際輸出時(shí)鐘信號(hào)相對(duì)于理想信號(hào)任何相應(yīng)邊沿偏移的時(shí)間長(zhǎng)度。而實(shí)際的跳變沿可以超前或者滯后其理想位置.一般可以用時(shí)間的絕對(duì)值或者頻率的百分比作...

2019-03-04 標(biāo)簽:噪聲PLL 1.1萬(wàn) 0

關(guān)于FPGA的三種電源需求淺析

VCCINT:核心工作電壓,PCI Express (PCIe) 硬核IP 模塊和收發(fā)器物理編碼子層(PCS) 電源。一般電壓都很低,目前常用的FPGA...

2019-02-27 標(biāo)簽:FPGAPLL 5.7k 0

利用集成鎖相環(huán)提高設(shè)計(jì)系統(tǒng)的頻率性能

利用集成鎖相環(huán)提高設(shè)計(jì)系統(tǒng)的頻率性能

鎖相環(huán)(PLL)是電子系統(tǒng)中功能最多,最靈活,最有價(jià)值的電路配置之一,因此可用于許多應(yīng)用。它用于時(shí)鐘重定時(shí)和恢復(fù),作為頻率合成器,以及作為可調(diào)諧振蕩器,...

2019-02-19 標(biāo)簽:檢測(cè)器pll無(wú)線(xiàn)電 6.2k 0

反孤島和智能電網(wǎng)保護(hù)

反孤島和智能電網(wǎng)保護(hù)

防孤島保護(hù)對(duì)于確保并網(wǎng)能量收集系統(tǒng)在電網(wǎng)本身斷電時(shí)切斷與電網(wǎng)的連接至關(guān)重要。然而,識(shí)別電網(wǎng)中的功率損耗可能具有挑戰(zhàn)性,需要能夠在對(duì)電網(wǎng)中的正常波動(dòng)的敏感...

2019-03-19 標(biāo)簽:鎖相環(huán)PLL過(guò)零檢測(cè)器 2.8k 0

Vivado中PLL開(kāi)發(fā)調(diào)用IP的方法

在開(kāi)發(fā)PL時(shí)一般都會(huì)用到分頻或倍頻,對(duì)晶振產(chǎn)生的時(shí)鐘進(jìn)行分頻或倍頻處理,產(chǎn)生系統(tǒng)時(shí)鐘和復(fù)位信號(hào),這是同步時(shí)序電路的關(guān)鍵,這時(shí)就需要使用到時(shí)鐘向?qū)P,下...

2018-12-22 標(biāo)簽:pllvivado 1.1萬(wàn) 0

SGMII接口基本功能仿真測(cè)試及常見(jiàn)異常問(wèn)題的解決方法

SGMII接口基本功能仿真測(cè)試及常見(jiàn)異常問(wèn)題的解決方法

SGMII接口(開(kāi)啟自協(xié)商)調(diào)試分為三個(gè)步驟,先測(cè)試SGMII最基本功能仿真、再測(cè)試SGMII最基本功能自回環(huán)上板、最后直接測(cè)試開(kāi)啟自協(xié)商功能后上板

2019-12-04 標(biāo)簽:測(cè)試仿真pll 1.3萬(wàn) 0

PCIe是什么?PCIe標(biāo)準(zhǔn)和PCIe布線(xiàn)規(guī)則總結(jié)概述

PCI-Express(peripheral component interconnect express)是一種高速串行計(jì)算機(jī)擴(kuò)展總線(xiàn)標(biāo)準(zhǔn),它原來(lái)的名...

2018-10-03 標(biāo)簽:PCIPLLPCIe 4.4萬(wàn) 0

零延遲時(shí)鐘頻率合成器技術(shù)應(yīng)用分解

零延遲時(shí)鐘頻率合成器技術(shù)應(yīng)用分解

零延遲指的是時(shí)鐘頻率合成器能夠提供與時(shí)鐘參考源邊沿對(duì)齊的輸出信號(hào),其應(yīng)用包括許多同步系統(tǒng),如SONET和SDH網(wǎng)絡(luò)、高速網(wǎng)絡(luò)服務(wù)器、網(wǎng)絡(luò)線(xiàn)路卡以及用于W...

2018-09-04 標(biāo)簽:PLL時(shí)鐘 5.8k 0

采用PLL技術(shù)實(shí)現(xiàn)最佳抖動(dòng)衰減的BAJA調(diào)整

采用PLL技術(shù)實(shí)現(xiàn)最佳抖動(dòng)衰減的BAJA調(diào)整

雖然系統(tǒng)中的自然高斯噪聲發(fā)生元件始終會(huì)引發(fā)抖動(dòng)但如果存在DJ則清楚地表明一個(gè)調(diào)制信號(hào)源正在向定時(shí)系統(tǒng)注入能量從直方圖的角度來(lái)看DJ充斥于中間部分從而擴(kuò)展...

2020-05-31 標(biāo)簽:噪聲pll測(cè)量 2.8k 0

用FPGA設(shè)計(jì)一階全數(shù)字鎖相環(huán)的方法

本文在說(shuō)明全數(shù)字鎖相環(huán)的基礎(chǔ)上,提出了一種利用FPGA設(shè)計(jì)一階全數(shù)字鎖相環(huán)的方法,并給出了關(guān)鍵部件的RTL可綜合代碼,并結(jié)合本設(shè)計(jì)的一些仿真波形詳細(xì)描述...

2018-10-25 標(biāo)簽:fpga鎖相環(huán)pll 9.6k 0

基于PE3240 PLL芯片實(shí)現(xiàn)L波段頻率源的設(shè)計(jì)方案

基于PE3240 PLL芯片實(shí)現(xiàn)L波段頻率源的設(shè)計(jì)方案

PE3240是Peregrine公司最新生產(chǎn)的一種可在高達(dá)2.2GHz頻段工作的分頻次數(shù)可編程的數(shù)字鎖相環(huán)芯片,正常工作狀態(tài)下功耗低于0.6W。PE32...

2020-07-16 標(biāo)簽:芯片pll計(jì)數(shù)器 3.8k 0

跳頻頻率合成器的性能指標(biāo)及仿真分析

跳頻頻率合成器的性能指標(biāo)及仿真分析

  跳頻通信技術(shù)是一種擴(kuò)頻技術(shù),也是最常用的一種擴(kuò)頻抗干擾技術(shù),通過(guò)載波頻率在一定的范圍內(nèi)按某種序列進(jìn)行跳變,使信號(hào)頻譜得以擴(kuò)展,以抑制信道中的干擾。跳...

2019-06-03 標(biāo)簽:噪聲仿真pll 4.5k 0

小數(shù)分頻技術(shù)與ADF4193快速開(kāi)關(guān)頻率合成器的研究

小數(shù)分頻技術(shù)與ADF4193快速開(kāi)關(guān)頻率合成器的研究

小數(shù)分頻是頻率合成中的一項(xiàng)新技術(shù)。這種技術(shù)的特點(diǎn)是使單環(huán)鎖相頻率合成器的平均分頻比變?yōu)樾?shù)。通過(guò)使分頻比變?yōu)樾?shù),可獲得任意小的頻率間隔,實(shí)現(xiàn)高頻率分辨...

2019-05-24 標(biāo)簽:fpga芯片pll 2.9k 0

利用雙PLL和DDS技術(shù)實(shí)現(xiàn)高速跳頻的改進(jìn)

利用雙PLL和DDS技術(shù)實(shí)現(xiàn)高速跳頻的改進(jìn)

飛行器制導(dǎo)接收機(jī)的任務(wù)是在飛行過(guò)程中不斷接收導(dǎo)引指令, 保證飛行器沿預(yù)定軌道飛行。由于對(duì)抗干擾、抗截獲性能的嚴(yán)格要求, 飛行器制導(dǎo)系統(tǒng)的通信體制目前都在...

2019-06-11 標(biāo)簽:plldds飛行器 6.6k 0

利用開(kāi)關(guān)的控制加速鎖相環(huán)鎖定的設(shè)計(jì)方法

利用開(kāi)關(guān)的控制加速鎖相環(huán)鎖定的設(shè)計(jì)方法

鎖相環(huán)(PLL)是模擬電路中的一個(gè)重要模塊,本文研究的是廣泛使用的電荷泵型鎖相環(huán)(CPPLL)。鎖相環(huán)電路通過(guò)比較參考輸入和輸出反饋信號(hào)的頻率/相位,并...

2019-06-14 標(biāo)簽:振蕩器pll鎖存器 4.9k 0

利用鎖相環(huán)技術(shù)對(duì)原動(dòng)機(jī)轉(zhuǎn)子速度變化的進(jìn)行測(cè)量

利用鎖相環(huán)技術(shù)對(duì)原動(dòng)機(jī)轉(zhuǎn)子速度變化的進(jìn)行測(cè)量

發(fā)電機(jī)組的功率-頻率特性和勵(lì)磁-無(wú)功(電壓)特性是影響電力系統(tǒng)安全經(jīng)濟(jì)運(yùn)行的最 重要的兩組物理量。電力系統(tǒng)的頻率主要取決于原動(dòng)機(jī)的出力,系統(tǒng)頻率變化是由...

2019-06-25 標(biāo)簽:pll頻率發(fā)電機(jī) 4.1k 0

晶體振蕩器存在于芯片中? 晶體振蕩器應(yīng)用匯總

為系統(tǒng)提供基本時(shí)鐘信號(hào)。通常,一個(gè)系統(tǒng)共享一個(gè)晶體振蕩器,以便于所有部件的同步。一些通信系統(tǒng)的基本頻率和射頻使用不同的晶體振蕩器,并通過(guò)電子頻率調(diào)節(jié)的方...

2018-08-07 標(biāo)簽:pll晶體振蕩器 6.3k 0

PCB設(shè)計(jì)中消除電源噪聲的方法有哪些?

1、注意板上通孔:通孔使得電源層上需要刻蝕開(kāi)口以留出空間給通孔通過(guò)。而如果電源層開(kāi)口過(guò)大,勢(shì)必影響信號(hào)回路

2018-07-21 標(biāo)簽:pcbPll數(shù)字電源 5.6k 0

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  • IOT
    IOT
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    IoT是Internet of Things的縮寫(xiě),字面翻譯是“物體組成的因特網(wǎng)”,準(zhǔn)確的翻譯應(yīng)該為“物聯(lián)網(wǎng)”。物聯(lián)網(wǎng)(Internet of Things)又稱(chēng)傳感網(wǎng),簡(jiǎn)要講就是互聯(lián)網(wǎng)從人向物的延伸。
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    海思
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  • STM32F103C8T6
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    COMSOL
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  • CD4046
    CD4046
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    加速度傳感器
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    加速度傳感器是一種能夠測(cè)量加速度的傳感器。通常由質(zhì)量塊、阻尼器、彈性元件、敏感元件和適調(diào)電路等部分組成。
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    服務(wù)機(jī)器人
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    四軸飛行器
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  • SDK
    SDK
    +關(guān)注
      SDK一般指軟件開(kāi)發(fā)工具包,軟件開(kāi)發(fā)工具包一般都是一些軟件工程師為特定的軟件包、軟件框架、硬件平臺(tái)、操作系統(tǒng)等建立應(yīng)用軟件時(shí)的開(kāi)發(fā)工具的集合。軟件開(kāi)發(fā)工具廣義上指輔助開(kāi)發(fā)某一類(lèi)軟件的相關(guān)文檔、范例和工具的集合。
  • 基站測(cè)試
    基站測(cè)試
    +關(guān)注
    802.11ac與11基站測(cè)試(base station tests) 在基站設(shè)備安裝完畢后,對(duì)基站設(shè)備電氣性能所進(jìn)行的測(cè)量。n的區(qū)別,802.11n無(wú)線(xiàn)網(wǎng)卡驅(qū)動(dòng),802.11n怎么安裝。
  • ESP8266
    ESP8266
    +關(guān)注
    wifi模塊ESP8266的默認(rèn)波特率是115200,但是單片機(jī)不能達(dá)到那么快的傳輸速率,只能使用4800bps,那么設(shè)置的時(shí)候,必不可少的要先用轉(zhuǎn)串口調(diào)試下載器。
  • TMS320F28335
    TMS320F28335
    +關(guān)注
    TMS320F28335是一款TI高性能TMS320C28x系列32位浮點(diǎn)DSP處理器
  • 靜電防護(hù)
    靜電防護(hù)
    +關(guān)注
    為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞,以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生,加速靜電泄漏,進(jìn)行靜電中和等。
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